データ駆動型プロセッサRAPIDのソフトウェア開発環境
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概要
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本稿では,データ駆動型マイクロプロセッサRAPID(Ring Architecture pipeline Intensive Data-driven processor)のマルチプロセッサ評価システムのハードウェア構成,およびRAPIDとホスト計算機間のメッセージ通信を利用したプログラムデバッグ手法について述べる.また,RAPIDに対する最適化コードを生成するために,並列化コンパイラが生成した実行コード(データフローグラフ)をサブグラフ単位で置換する手法について提案する.
- 一般社団法人情報処理学会の論文
- 1994-12-08
著者
-
岩田 誠
高知工科大学大学院工学研究科
-
小守 伸史
三菱電機(株)先端技術総合研究所
-
久間 和生
三菱電機(株)先端技術総合研究所
-
小守 伸史
三菱電機(株)
-
田村 俊之
三菱電機先端技術総合研究所
-
坪田 浩乃
三菱電機(株) 先端技術総合研究所
-
田村 俊之
三菱電機(株) 先端技術総合研究所
-
岩田 誠
大阪大学工学部情報システム工学科
-
寺田 浩詔
大阪大学工学部情報システム工学科
-
田村 俊之
三菱電機(株)先端技術総合研究所
-
久間 和生
三菱電機(株)
-
坪田 浩乃
三菱電機(株)先端技術総合研究所
-
岩田 誠
高知工科大学
-
寺田 浩詔
大阪大学工学部
-
寺田 浩詔
大阪大学
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