データ駆動型ネットワークプロセッサにおける高速パケット分類処理(ARC-3:専用プロセッサと時刻管理)(2003年並列/分散/協調処理に関する『松江』サマー・ワークショップ(SWoPP松江2003))
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概要
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基幹ネットワークの全光化に伴って,境界ルータや家庭内ゲートウェイを高機能化・高速化する要請が高まっている.本稿では,特に処理負荷の重いパケット分類処理を対象に,アルゴリズムの高速パイプライン化を図り,パイプライン処理能力に優れたデータ駆動型プロセッサ上で効果的にソフトウェア実現するプロセッサ構成を提案する.そして,試作ハードウェアによる回路規模の評価から,数%のハードウェアコスト増で提案回路が構成可能であり,最大12M pps (IPv4 packets per second)の性能を達成できること示す.
- 一般社団法人情報処理学会の論文
- 2003-08-05
著者
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