オンチップ評価機構を搭載した自己タイミング型パイプラインシステムの検討(一般セッションF <特集>Funny Architecture II)
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概要
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集積化技術の進展によって, 近い将来, オンチップ・シミュレータ/エミュレータとしても再構成可能なプロセッサ・コアを多数搭載したチップマルチプロセッサ(CMP)も容易に実現できると考えられる.特に, 組込みシステムの分野では, 各種の応用領域に特化した組込みチップ・アーキテクチャが要求されるため, ある世代の製品と次世代のプロトタイプが共存できるチップ構成の導入によって, システム設計のコストと期間を大幅に削減できる可能性がある.本稿では, この着想を, 自己タイミング型パイプラインによるデータ駆動型マルチプロセッサに適用し, その回路構成法を提案する.
- 一般社団法人情報処理学会の論文
- 2005-11-30
著者
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