パイプラインステージ統合をオンチップで制御する低消費電力プロセッサのFPGA実装と評価(低消費電力技術,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
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概要
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本論文では,クロック周波数を制御し,パイプラインステージを統合することで消費電力を削減するパイプラインステージ統合(PSU: Pipeline Stage Unification)をオンチップの制御機構を用いて制御するプロセッサのFPGA実装と評価について述べる.プロセッサは組み込み向けの32ビット6段パイプライン構成である.オンチップの制御機構は目標性能に合わせ動的にパイプラインステージ数を6段,3段,2段に変更できる.これらをFPGAに実装した結果,PSUを搭載することによる面積の増加は,メモリを除くプロセッサ全体の15.3%程度である.消費電力はDVFSと比較して最大で6.3%削減でき,消費エネルギーは最大で9.8%削減できた.
- 2007-11-14
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