即時通信を行うハードウェアのサイクル精度動作記述モジュール群に対するモデル検査の一手法(FPGAとその応用及び一般)
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概要
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ハードウェアには配線遅延があるためクロック周波数の向上に限界がある.そこで,実行時間削減を目的としてクロックサイクルを消費しない即時通信がしばしば用いられる.そのような通信を行うサイクル精度動作記述には,組み合わせ回路としての閉路が発生することに起因する値の発振や発散の可能性といった難しさがある.そこで,本論文ではwireによる即時通信を行うサイクル精度動作記述モジュール群に発振や発散の問題が生じるか否か等を,モデル検査によって検証する手法を提案する.実験では上述した問題の発生を含んだ簡単なテストケース群に対して提案手法を適用し,その有効性を確認した.
- 社団法人電子情報通信学会の論文
- 2007-01-11
著者
-
中田 明夫
広島市立大学大学院情報科学研究科
-
東野 輝夫
大阪大学大学院情報科学研究科
-
中田 明夫
広島市立大学情報科学研究科
-
藤田 裕久
大阪大学大学院情報科学研究科
-
濱田 雅彦
大阪大学大学院情報科学研究科
-
谷本 匡亮
大阪大学大学院情報科学研究科
-
中田 明夫
大阪大学大学院情報科学研究科
-
東野 輝夫
大阪大学大学院情報科学研究科|独立行政法人科学技術振興機構 Crest
-
東野 輝夫
大阪大学大学院情報学研究科
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