ネットワークオンチップにおける回路面積と配線コストを考慮したチップ内通信構造最適化の一手法(コンピュータシステムの設計・検証及び一般,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
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概要
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本研究では,Processing Element(PE)間の通信の動的な振舞いを考慮したネットワークオンチップ(NoC)の準最適構造を整数線形計画法(ILP)によって定式化し,導出する手法を提案する.提案する手法では,実装後のチップサイズに対する制約と,モジュール数,リンク遅延,PE間で生じる通信動作の集合とそれらの順序に関する制約,および,通信のデッドラインを入力として与え,与えられた通信のデッドラインを満たし,かつ通信資源コスト,ルータとモジュール間のリンクの数を最小化するようなNoCの通信構造を解として持つ整数線形制約式を導出する.さらに本研究では得られた制約式に対して,さらにヒューリスティックな見積もりを元に制約を追加し,解を得る計算時間を削減する手法を提案する.
- 2007-11-13
著者
-
林 大輔
大阪大学大学院情報科学研究科
-
村井 渉
大阪大学大学院情報科学研究科
-
中田 明夫
広島市立大学大学院情報科学研究科
-
木谷 友哉
奈良先端科学技術大学院大学情報科学研究科
-
安本 慶一
奈良先端科学技術大学院大学情報科学研究科
-
東野 輝夫
大阪大学大学院情報科学研究科
-
林 大輔
大阪大学基礎工学部
-
中田 明夫
広島市立大学情報科学研究科
-
木谷 友哉
静岡大学若手グローバル研究リーダー育成拠点
-
中田 明夫
広島市立大学 大学院情報科学研究科
-
東野 輝夫
大阪大学大学院情報科学研究科|独立行政法人科学技術振興機構 Crest
-
木谷 友哉
静岡大学 若手グローバル研究リーダー育成拠点
-
木谷 友哉
奈良先端科学技術大学院大学
-
安本 慶一
奈良先端科学技術大学院大学
-
東野 輝夫
大阪大学大学院情報学研究科
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