チップ内ネットワークの性能要求検証および最適化のための一手法(ネットワーク,通信)
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概要
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本研究では,通信の動的な振舞いを考慮したチップ内ネットワークの性能要求検証手法,および,通信スケジューリングの最適化手法を提案する.提案する性能要求検証手法では,時間ペトリネットによって,チップ内ネットワークの動的振舞いをミクロ的にモデル化する.次に,通信のレイテンシ・スループットに関する要求性能を満たし,かつ,デッドロックが起こらないことをモデル検査によって検証する.通信スケジューリング最適化手法では,アプリケーションの各通信フローに対して,まず,レイテンシ要求を満たすために当該フローが通過するルータ群に対する時間制約を導出する.次に,得られた制約に基づいて,静的スケジューリング理論に基づくTDMAタイムスロット割り当て手法を適用することにより,より効率的にルータ資源を利用し,かつ,性能要求を満たす通信スケジューリング解の探索を行う.
- 2007-03-15
著者
-
村井 渉
大阪大学大学院情報科学研究科
-
中田 明夫
広島市立大学大学院情報科学研究科
-
木谷 友哉
奈良先端科学技術大学院大学情報科学研究科
-
安本 慶一
奈良先端科学技術大学院大学情報科学研究科
-
東野 輝夫
大阪大学大学院情報科学研究科
-
林 大輔
大阪大学基礎工学部
-
中田 明夫
広島市立大学情報科学研究科
-
木谷 友哉
静岡大学若手グローバル研究リーダー育成拠点
-
中田 明夫
大阪大学大学院情報科学研究科
-
東野 輝夫
大阪大学大学院情報科学研究科|独立行政法人科学技術振興機構 Crest
-
木谷 友哉
静岡大学 若手グローバル研究リーダー育成拠点
-
木谷 友哉
奈良先端科学技術大学院大学
-
安本 慶一
奈良先端科学技術大学院大学
-
東野 輝夫
大阪大学大学院情報学研究科
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