90nmCMOSを用いた電流モード高速パイプライン型ADCの研究(ディジタル・情報家電,放送用,ゲーム機用システムLSI,回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
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概要
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微細化CMOSに適した高速低電力のパイプライン型ADCの回路構成を検討し,90nmCMOSデバイスを用いて,電源電圧1Vで動作し,8ビット500MS/sの性能を目標にしてテストチップを設計した.ADCのパイプラインステージの増幅回路,差分回路およびコンパレータにはカレントミラーをベースとする電流モード回路を用い,増幅回路はオープンループ構成にして回路を単純化することにより高速・低消費電力化を図った.微細デバイスで問題となる素子ミスマッチによる精度劣化は冗長ビット構成とデジタルキャリブレーション技術により抑圧した.回路シミュレーションにより,DNLが0.8LSB,INLが1.4LSBまた,アナログ回路部の消費電力を42mW程度の性能であることを確認した.
- 2006-12-07
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