画像認識のための画素並列領域抽出アルゴリズムとFPGAへの実装
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概要
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本論文では, 画像の領域分割後に得られるエッジ情報を利用し, エッジで囲まれた領域を画素並列で個別に抽出するアルゴリズムとそれを実現するLSI回路構成を提案する.1画素毎に1処理モジュールを割当て, 隣接画素の状態で自分の状態を決めるセルオートマトン型のアルゴリズムである.提案する画素回路は極めてコンパクトなので, すでに提案されている画像分割用画素回路内に組み込むことができるが, 今回はFPGAに実装した例を示し, 画素並列処理がどの程度現状のFPGAで可能かを議論する。
- 2001-07-26
著者
-
岩田 穆
広島大学大学院先端物質科学研究科
-
中野 鉄平
広島大学大学院先端物質科学研究科
-
彦本 里美
広島大学大学院先端物質科学研究科(現)松下電器情報システム広島研究所
-
森江 隆
広島大学大学院先端物質科学研究科
-
永田 真
広島大学大学院先端物質科学研究科
-
彦本 里美
広島大学大学院先端物質科学研究科(現):松下電器情報システム広島研究所
-
中野 鉄平
九州工業大学大学院生命体工学研究科
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