非同期式回路検証器における使用記憶域削減について
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概要
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回路の検証を行なう上での問題点は, 検証にかかる計算時間と, 使用するメモリの量である. 特に実時間システムの検証器では明示的な状態表現を用いるので, メモリに関する問題がより深刻である. そこで本研究では, 有限遅延幅モデルにおける非同期式回路の検証器について, 状態の部分情報の共有, ハフマン符号化, 記憶状態の間引きの3つの方針によって使用記憶域を削減することを提案し, STARIの回路の検証においてはメモリ使用量は1/5になることを示した. 又, 3つの方法を組み合わせることによる利点も示した.
- 1999-04-16
著者
-
米田 友洋
国立情報学研究所
-
米田 友洋
東京工業大学大学院情報理工学研究科計算工学専攻
-
及川 恒平
東京工業大学大学院情報理工学研究科計算工学専攻
-
北村 宏太
東京工業大学大学院情報理工学研究科計算工学専攻
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