128ビットブロック暗号Camelliaの実装評価
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概要
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本報告では128ビットブロック暗号Camelliaのソフトウェア及びハードウェア上での実装に関する検討・評価結果について報告する。ソフトウェア上での実装に関しては、Camelliaを最適化実装するための手法について検討し、それらの最適化手法を組み合わせて、8ビット、32ビットおよび64ビットCPU上で実際に実装評価を行った結果について報告し、Camelliaが様々なプラットフォーム上で効率的な実装が可能であることを示す。またハードウェア上での実装に関しては、高速実装および小型実装について見当する。その結果、高速実装に関しては約1.2Gb/Sを達成し、また小型実装においては約11Kgatesで実現するなど、優れたハードウェアを実装性示す。
- 社団法人電子情報通信学会の論文
- 2000-09-22
著者
-
青木 和麻呂
日本電信電話(株)
-
市川 哲也
三菱電機株式会社情報技術総合研究所
-
松井 充
三菱電機株式会社情報技術総合研究所情報セキュリティシステム開発センター
-
青木 和麻呂
日本電信電話株式会社ntt情報流通プラットフォーム研究所
-
盛合 志帆
ソニー株式会社
-
神田 雅透
日本電信電話株式会社 情報流通プラットフォーム研究所
-
盛合 志帆
日本電信電話株式会社 情報流通プラットフォーム研究所
-
中嶋 純子
三菱電機株式会社 情報技術総合研究所
-
時田 俊雄
三菱電機株式会社 情報技術総合研究所
-
盛合 志帆
通信・放送機構 横浜リサーチセンター
-
青木 和麻呂
日本電信電話 (株)
-
松井 充
三菱電機 情報技総研
-
時田 俊雄
三菱電機
-
松井 充
三菱電機株式会社情報技術総合研究所
-
神田 雅透
Ntt 情報流通プラットフォーム研
-
盛合 志帆
ソニー
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