128ビットブロック暗号CLEFIAのハードウェア実装評価
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概要
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本稿では,128ビットブロック暗号CEFIAのハードウェア実装における最適化手法の検討およびその評価結果について報告する.主にF関数内に含まれる2種類のS-boxと2種類の拡散行列を効率的に実装する手法,および鍵スケジュール部で使用しているDoubleSwap関数と呼ばれる置換関数を効率的に実装する手法について述べる.本稿で述べる最適化手法を適用することにより,128ビット鍵のCLEFIAでは,0.09μmCMOS標準セルライブラリを用いた場合に,高速版実装において6Kgate以下で1.60Gbpsを,小型版実装において5Kgate以下で0.71Gbpsを実現している.これらの数値は,AESやCamelliaの既知の実装結果と比較して十分なアドバンテージを持っており,CLEFIAが高いハードウエア実装性能を持ったブロック暗号であることを示している.
- 一般社団法人情報処理学会の論文
- 2007-07-19
著者
-
秋下 徹
ソニー株式会社インターネット研究所
-
白井 太三
ソニー株式会社 ユビキタス技術研究所
-
岩田 哲
名古屋大学
-
渋谷 香士
ソニー株式会社
-
盛合 志帆
ソニー株式会社
-
秋下 徹
ソニー(株)ユビキタス技術研究所
-
盛合 志帆
通信・放送機構 横浜リサーチセンター
-
秋下 徹
ソニー株式会社
-
白井 太三
ソニー株式会社
-
盛合 志帆
ソニー
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