ブロック暗号のハードウェア実装に関する評価指標について(1)
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概要
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本稿では、暗号アルゴリズムのハードウェア(H/W)実装における従来の評価指標の問題点を解決するため、実装アーキテクチャの違いを正規化するための新たな指標、「単位回路規模および単位Latency当たりの処理速度(Throughput/{Area^* Latency})」を提案する。また、128bit鍵版Camelliaおよびその簡略版をいくつかの実装アーキテクチャでXilinx社製FPGA(Virtex-Eシリーズ、XCV1000E-8-FG1156)に実装し、本提案指標の有意性の検証および考察を行ったので報告する。
- 社団法人電子情報通信学会の論文
- 2001-09-10
著者
-
市川 哲也
三菱電機株式会社情報技術総合研究所
-
松井 充
三菱電機株式会社情報技術総合研究所情報セキュリティシステム開発センター
-
粕谷 智巳
三菱電機株式会社情報技術総合研究所
-
反町 亨
三菱電機株式会社情報技術総合研究所
-
松井 充
三菱電機 情報技総研
-
反町 亨
三菱電機(株)
-
松井 充
三菱電機株式会社情報技術総合研究所
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