超並列計算機の相互結合網
スポンサーリンク
概要
- 論文の詳細を見る
現在1,000台以上の規模の超並列計算機の開発が各所で急速に進められている。このような超並列計算機では、PE単体での処理能力のみならず、PE間で行なわれる(広い意味での)通信の特性が成否の鍵を握る、と我々は考える。つまり、いかに優れた通信特性を提供できるかがポイントとなる。通信コストの問題はすでに等で提案・検討されており、現在支配的なコスト要因となっているメッセージハンドリングの問題は解決に向かうものと考えられる。そのため相対的に相互結合網の性能が重要となる。どのようなトポロジで大規模システムを構築するか。大規模化に伴い増加するレイテンシをどう抑えるか。また、結合網は必然的にシステムの骨組みおよび神経系の役割を担うことになり、単なるデータ転送媒体以上の機能が要求されるようになるが、これにどう応えるか。超並列時代を迎えるにあたって、このように多くの問題が残っている。本稿ではまずその解決の糸口をつかむため、以下に相互結合網に求められる要件を整理し、今後の見通しについて概観する。
- 一般社団法人情報処理学会の論文
- 1993-03-01
著者
関連論文
- 実時間用並列計算機アーキテクチャの検討
- 商用マルチコアプロセッサ向けクラスタ化パイプラインマルチスレッド実行
- リアルワールドコンピューティングにおける光インターコネクション
- 超並列計算機RWC-1搭載光インタコネクト
- 超並列計算機RWC-1内光インタコネクトシステム
- 超並列計算機RWC-1における光インターコネクション
- 超並列計算機応用光インターコネクション技術
- データ駆動計算機のアーキテクチャ最適化に関する考察
- データ駆動計算機EM-4の負荷分散
- データ駆動計算機EM-4のパイプライン構成
- データ駆動計算機EM-4のプロトタイプの構成
- データ駆動計算機EM-4における待ち合せ機構
- データ駆動計算機EM-4における要素プロセッサのシングルチップ化の検討
- データ駆動型シングルチッププロセッサのアーキテクチャ
- データ駆動型シングルチップによる高並列計算機の実行制御方式
- 超並列計算機のための同期処理機構とその評価
- 超並列計算機RWC-1の入出力機構とその基礎評価(並列処理)
- 超並列計算機BWC-1相互結合網ルータの実現
- マルチスレッド計算機における同期機構とパイプライン構成
- 超並列要素プロセッサRICA-1とその基本性能
- 超並列要素プロセッサRICA-1とその基本性能
- 超並列要素プロセッサRICA-1とその基本性能
- 相互結合網のトポロジを活かしたシステム支援機能とその評価
- 超並列計算機におけるマルチスレッド処理機構と基本性能
- RWC-1の要素プロセッサ : 細粒度並列処理機能の強化
- RWC-1 におけるスレッド実行と基本性能
- RWC-1の入出力機構と基本性能
- 相互結合網の転送パターンと定常・非定常性能について
- 並列型AIマシン (「AIマシン」)
- 細粒度通信機構を持つ並列計算機EM-Xによる疎行列計算の性能評価
- 細粒度通信機構を用いたRadixソートの実行
- 行列演算ベンチマークを用いた並列計算機EM-Xの評価
- RWC-1のシステム構成と基本動作
- EM-Cによるニューラルネットワークの実現
- EM-Cによる共有二分決定グラフの並列処理
- EM-Cによる粒度最適化の検討
- 並列計算機EM-4の並列プログラミング言語画EM-C
- RWC-1の入出用ATMノード
- RWC-1のマルチスレッド処理機構
- RWC-1における多レベル並列処理
- データ駆動計算機における静的負荷分散方式の検討
- 2パス限定投機システムにおける投機的メモリアクセスの検討(2010年並列/分散/協調処理に関する『金沢』サマー・ワークショップSWoPP2010)
- 5M-5 2パス限定投機システムPALSの評価環境 : システムシミュレータ(マルチスレッドと分岐,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 4M-5 パスベーススレッド分割手法に基づく自動並列化処理の実装(チップマルチプロセッサ,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 5M-2 2パス限定投機システムのハードウェア設計 : メモリアクセス機構(マルチスレッドと分岐,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 5M-7 H.264デコーダにおける2パス限定投機方式の適用検討(マルチスレッドと分岐,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- バイナリレベル変数解析に基づいた自動並列化処理の初期評価(システムアーキテクチャ2,デザインガイア2010-VLSI設計の新しい大地-)
- Prologを指向したRISCプロセッサのパイプライン構成
- Pegasus Prologプロセッサにおける並列データパス操作の導入
- 1N-2 パスベーススレッド分割による並列実行性能の評価(システム評価,学生セッション,ソフトウェア科学・工学,情報処理学会創立50周年記念)
- 5M-6 2パス限定投機システムPALSの評価環境 : 言語処理系(マルチスレッドと分岐,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 5M-3 2パス限定投機システムのハードウェア設計 : マルチスレッド制御機構(マルチスレッドと分岐,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 5M-1 2パス限定投機方式における動的最適化適用可能性の検討(マルチスレッドと分岐,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 4M-4 バイナリレベル変数解析に基づいた自動並列化システムの実装(チップマルチプロセッサ,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 4M-1 グラフ理論に基づくスレッド分割おけるループ性能向上法(チップマルチプロセッサ,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 2M-7 広域情報によるTurn-Modelの高性能化(ネットワークアーキテクチャ,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- 2パス限定投機方式を実現するマルチコアプロセッサPALSの提案(高性能コンピュータシステム,デザインガイア2009-VLSI設計の新しい大地-)
- 2Q-6 バーチャルリモートPCの開発
- 2Q-5 バーチャルリモートPCのアーキテクチャ
- RWC-1の入出力リングバス : テストベッド上での実装
- RWC-1の階層型MDCE網
- 超並列向け相互結合網MDCEの提案と評価
- RWC-1相互結合網用プロトタイプ・ルータの設計
- 超並列計算機RWC-1の命令セットアーキテクチャ
- RWC-1相互結合網用プロトタイプ・ルータの設計
- 超並列計算機RWC-1の命令セットアーキテクチャ
- 超並列計算機RWC-1用プロセッサチップの設計
- 超並列計算機RWC-1用プロセッサチップの設計
- 超並列計算機の相互結合網
- 90-8 KCM : 高速知識処理マシン
- 並列計算機EM-4におけるマルチスレッドプログラミングモデルと性能評価
- 海外の並列処理研究動向 : MITにおける並列処理研究の現状
- 3. 並列処理の諸問題 3.3 並列計算機におけるスケジューリングと負荷分散 (並列処理技術)
- 2パス限定投機方式における最適投機対象パスの動的変更手法の検討(アーキテクチャ,2011年並列/分散/協調処理に関する『鹿児島』サマー・ワークショップ(SWoPP鹿児島2011))
- データ駆動計算機EM-4における基本動作試験法
- データ駆動計算機EM-4プロトタイプのハードウェア構成
- データ駆動計算機EM-4プロトタイプのデバグ環境
- データ駆動型シングルチッププロセッサEMC-Rの動作原理と実装 (並列処理)
- チェックポインティングとコード差分実行による時短シミュレーション法の提案
- 流量制限による相互結合網の実効性能改善の検討
- 流量制限による相互結合網の実効性能改善の検討
- データ駆動計算機EM-4における資源管理の実現
- 高並列計算機EM-4とその並列性能評価
- EM-4における適応型最適化方式
- EM-4における動的関数分散方式の評価
- データ駆動計算機EM-4プロトタイプにおけるソフトウェア体系
- データ駆動計算機EM-4プロトタイプにおける強連結化効果
- データ駆動計算機EM-4プロトタイプの性能評価
- データ駆動計算機EM-4プロトタイプの並列動作性能予備評価