超並列計算機におけるマルチスレッド処理機構と基本性能
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概要
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超並列計算機においては, 遠隔メモリ操作や遠隔手続き呼び出しにともなうレイテンシが大きな問題となる. これを解決する手段として, マルチスレッド処理によるレイテンシの隠蔽があげられる. さまざまな粒度におけるマルチスレッド処理を効率良く実行するためには, 効果的なハードウェアによる支援が期待できるようなスレッド処理機構を, プロセッサが備える必要がある. 本稿では, 効率良くマルチスレッド処理を実行するスレッド処理機構について考え, 超並列計算機向けのプロセッサアーキテクチャを示す. そしてこれに基づいて現在開発中の, マルチスレッド型プロセッサRICA-1を紹介し, その基本性能を示す. また, 遠隔メモリ操作や遠隔手続き呼び出しなどが, マルチスレッド処理によるレイテンシ隠蔽によって, 効率良く実現できることを示す.
- 一般社団法人情報処理学会の論文
- 1996-12-15
著者
-
松岡 浩司
日本電気株式会社 C&c メディア研究所
-
松岡 浩司
Rwcp並列分散パフォーマンス研究室:(現)nec C&c メディア研究所
-
廣野 英雄
三洋電機株式会社
-
横田 隆史
三菱電機(株)先端技術総合研究所
-
坂井 修一
筑波大学電子・情報工学系
-
岡本 一晃
三洋電機株式会社
-
横田 隆史
三菱電機株式会社先端技術総合研究所
-
岡本 一晃
新情報処理開発機構
-
松岡 浩司
新情報処理開発機構
-
廣野 英雄
新情報処理開発機構
-
横田 隆史
新情報処理開発機構
-
坂井 修一
筑波大学 電気・情報工学系
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