データ駆動計算機EM-4のパイプライン構成
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概要
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シングルチッププロセッサEMC-Rによって構成されるデータ駆動計算機EM-4を開発中である。EM-4では、処理のさまざまな並列化・重畳化をおこなっている。その概略を以下に記す。(1)データフローグラフによって表現される並列性を、要素プロセッサ(PE)間に展開することによる並列化。(2)データフローグラフによって表現される並列性を、PE内の循環パイプライン上に展開することによる重畳化。(3)同一PE内における先行制御。(4)データ授受機能と処理機能の並列化。(5)結合網上でのパケット転送の重畳化。(6)関数の部分実行を用いた先行制御。(7)擬結果関数を用いた先行制御。(8)負荷分散の先行制御。このうち、(1)(2)(6)はすでにほとんどのデータ駆動計算機上で実現されており、(1)はEM-3などで、(8)はSIGMA-1などで実装されている。また、(4)はすでに報告しており、(8)は別途報告するので、ここでは触れない。EM-4では、従来のデータ駆動計算機で困難とされていた(3)の制御を自然な形で取り入れることで、処理を高速化した。ここでは、(3)を実現するための新しい計算モデルの導入、(2)と(3)の2種のパイプラインの融合、(2)(3)のためのハードウェア機構などについて報告する。
- 社団法人情報処理学会の論文
- 1989-03-15
著者
-
平木 敬
東京大学大学院情報理工学系研究科
-
児玉 祐悦
電子技術総合研究所情報アーキテクチャ部
-
山口 喜教
電子技術総合研究所情報アーキテクチャ部
-
児玉 祐悦
電子技術総合研究所
-
平木 敬
電子技術総合研究所,東京大学理学部情報科学科
-
坂井 修一
電子技術総合研究所
-
平木 敬
東京大学理学部情報科学科 電子技術総合研究所
-
山口 喜教
電子技術総合研究所
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