実行時再構成方式におけるバイナリトランスレーション支援
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概要
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逐次プログラムを実行時に並列投機実行するアーキテクチャ、実行時再構成方式のハードウェア上で、実行前にバイナリプログラムを解析、再構成することで、より効果的な並列実行を行うバイナリトランスレーション方式を提案する。投機実行ハードウェアを用いる命令を追加し、投機実行時のプログラム制御構造を明示し並列投機実行の実行管理を容易にし、実行時の依存解析を前もって行うことにより投機実行に必要とあるメモリアクセス保護資源を静的に割り当てる。これらの最適化によって実行時の解析オーバーヘッドを減少させ、高速な並列投機実行を実現する。
- 社団法人電子情報通信学会の論文
- 2001-07-18
著者
-
平木 敬
東京大学大学院情報理工学系研究科
-
松本 尚
日本医科大学千葉北総病院救命救急センター
-
松本 尚
東京大学大学院理学系研究科情報科学専攻:科学技術振興事業団さきがけ研究21「情報と知」領域
-
玉造 潤史
東京大学理学系研究科
-
玉造 潤史
東京大学情報基盤センター
-
松本 尚
東京大学大学院情報理工学系研究科:科学技術振興事業団さきがけ研究21「情報と知」領域
-
松本 /尚
東京大学大学院理学系研究科情報科学専攻
-
平木 敬
東京大学大学院情報理工学研究科
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