2000-ARC-139-19 Superscalarにおける低遅延な命令スケジューリング方式
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概要
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従来のSSの動的命令スケジューリングのロジックは、CAMで構成され、配線遅延に支配されるため, LSIの微細化に伴ってクリティカルになる.我々は, 命令に宛先を埋め込むことでこのCAMをRAMに置き換えることができるアーキテクチャDualflowを提案してきた.本研究では, SSの命令をデコード時に宛先に変換することで, SSの命令互換性を保ったままDualflow並みの高速な動的命令スケジューリングを行う回路を提案する.本方法ではデコードステージが1サイクル伸びるが, それによる分岐ミスペナルティの増加は少ない.
- 一般社団法人情報処理学会の論文
- 2000-08-03
著者
-
富田 眞治
京都大学情報学研究科
-
五島 正裕
京都大学情報学研究科
-
森 眞一郎
京都大学情報学研究科
-
グェン ハイハー
京都大学情報学研究科
-
縣 亮慶
京都大学情報学研究科
-
中島 康彦
京都大学経済学研究科
-
ハイハー グェン
京都大学情報学研究科
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