形式的手法を用いたin-order実行パイプラインCPUの自動設計検証(<特集>並列処理)
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概要
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命令のin-order実行のみ行うパイプラインCPUに対する設計法および設計した回路(動作レベル・RTレベル)が要求仕様(命令の定義)を正しく実現していることを代数的手法を用いて完全自動で証明する手法を提案する.本論文では, まず, (1)パイプラインの各ステージごとの正しさの証明をステージ単位の帰納法で行えるようにするため, CPUのクラスを定式化し, (2)パイプライン化の正しさの証明法を与えている.そして, (3)提案する手法に基づく完全自動の検証系を作成し, 新たに設計した5段のパイプラインCPU(DLXのサブセット)の設計検証を行った例を示している.設計したCPUには通常の設計で行われるようにフォワーディングやストールを取り入れているが, 検証系によるステージ単位の自動証明は成功し, パイプライン化の正しさの証明全作業に要した時間は30分程度であった.
- 一般社団法人情報処理学会の論文
- 1998-06-15
著者
-
東野 輝夫
大阪大学大学院情報科学研究科
-
北嶋 暁
大阪大学大学院基礎工学研究科情報数理系専攻
-
谷口 健一
大阪大学大学院情報科学研究科
-
東野 輝夫
大阪大学大学院情報科学研究科|独立行政法人科学技術振興機構 Crest
-
森岡 澄夫
日本電気システムIPコア研究所
-
森岡 澄夫
大阪大学大学院基礎工学研究科情報数理系専攻:(現)日本アイ・ビー・エム株式会社
-
島谷 肇
大阪大学大学院基礎工学研究科情報数理系専攻:(現)株式会社東芝
-
北嶋 暁
大阪電気通信大学総合情報学部メディアコンピュータシステム学科
-
森岡 澄夫
日本電気株式会社システムipコア研究所
-
東野 輝夫
大阪大学大学院情報学研究科
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