RDRアーキテクチャを対象とした部分2重化フォールトセキュア高位合成手法(設計技術,組込み技術とネットワークに関するワークショップETNET2012)
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概要
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半導体の微細化技術の向上に伴い,ソフトエラーによる信頼性低下が問題となっている.そのため,LSIにエラー検出機能を組み込むフォールトセキュア設計の必要性が高まっている.一方,微細化技術の向上によりゲート遅延より配線遅延が支配的となったため,高位合成段階で配線遅延を予測する必要が生じている.配線長が不定である従来のレジスタ集中型アーキテクチャに対し,レジスタをチップ内に均等に配置することで配線長を一定とするRDRアーキテクチャが提案されている.本稿ではRDRアーキテクチャを対象とした,部分2重化によるフォールトセキュア高位合成手法を提案する.提案手法では入力CDFGの演算ノードを一部2重化することで,レイテンシ制約内で信頼性を最大化する.RDRアーキテクチャで生じる空き領域をフォールトセキュア設計に利用することで面積効率を向上させると同時に, 2重化可能な演算ノード数を増加させる.続いて,挿入比較ノード数を最小化するスケジューリング・バインディングを行うことで余分な演算器動作を抑制し,信頼性向上を図る.計算機実験により提案手法は,フォールトセキュア設計を利用しない手法と比して最大57%信頼性を向上させるフォールトセキュア高位合成が可能であることを確認した.
- 2012-02-24
著者
-
戸川 望
早稲田大学
-
田中 翔
奈良先端科学技術大学院大学情報科学研究科
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
坂田 雅雄
早稲田大学院基幹理工学研究科情報理工学専攻
-
柳澤 政生
早大・理工
-
戸川 望
早稲田大学院基幹理工学研究科情報理工学専攻
-
柳澤 政生
早稲田大学理工学研究科
-
柳澤 政生
早稲田大
-
田中 翔
奈良先端科学技術大学院大学
-
戸川 望
早稲田大学理工学部電子通信学科
-
柳澤 政生
早大
-
田中 翔
早稲田大学大学院基幹理工学研究科情報理工学専攻
-
田中 翔
関西テレビ放送(株)放送技術局
-
柳澤 政生
早稲田大学
-
柳澤 政生
現在,早稲田大学大学院基幹理工学研究科電子光システム学専攻
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