立下りFFを使ったブリッジ削減設計手法(ネットワークプロセッサ,通信のための信号処理,無線LAN/PAN,一般)
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概要
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本稿では、ダイナミック消費電力増加の原因の1つである回路中のFFが発生するグリッジを消去するための立下りFF(FFF)を挿入設計手法について述べる。立下りFFはその挿入に関して、クロックの半分の周期の遅延を挿入するため、ブリッジの発生をブロックする役割を果たす。しかし、挿入されるFFのスキューを考慮する必要がない反面、挿入による面積増加が大きな問題となる。そこで、本稿ではブリッジ削除を目的としたFFF挿入手法を提案する。本手法は、与えたれた回路からバッファ・インパークの削除を行う前処理を行ってから後段のFFからFFFの挿入箇所を探索することによって、パッファを使ったHoldエラー補償と比較して10%程度の面積増加で、FF間パスの30%に立下りFFを挿入して、ブリッジを削除可能であることを示した。
- 2011-02-24
著者
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