ビアプログラマブルデバイスに最適な基本論理ゲートアーキテクチャの検討(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
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概要
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マスクコスト等を含む初期開発費の増大しているシステムLSIの低コスト化のために,数層のマスクで論理をカスタマイズできるストラクチャードASICが検討されている.我々はビア2層で論理を変更できるビアプログラマブルデバイスVPEXを開発してきた.VPEXは,基本論理ゲート(LE)として複合ゲート型EXOR論理ゲートとインバータを用いており,すペての2入力論理に加えて,AOIやMUXなどの3入力論理を実現でき,LE2個でDFFを形成できることが特微である.LUTやSOPを用いた他の 2入力LEと比較すると,VPEXは面積・遅延は同等以下で,消費電力は1/2以下と,低消費電力性で優位であることを示してきた.本論文では,より一般的な2〜4入力LUTを比較対象として,べンチマーク回路の論理合成結果から,面積・速度を比較・検討した結果を報告する.
- 2010-03-03
著者
-
藤野 毅
立命館大学理工学部
-
吉川 雅弥
名城大学理工学部
-
西本 智広
立命館大学院理工学研究科
-
國生 雄一
立命館大学院理工学研究科
-
山田 翔太
立命館大学院理工学研究科
-
吉田 直之
立命館大学院理工学研究科
-
堀 遼平
立命館大学院理工学研究科
-
松本 直樹
立命館大学理工学研究科
-
松本 直樹
立命館大学院理工学研究科
-
藤野 毅
立命館大学vlsiセンター
-
吉田 直之
立命館大学大学院理工学研究科
-
堀 遼平
立命館大学大学院理工学研究科
-
松本 直樹
立命館大学大学院理工学研究科
-
吉川 雅弥
Jst‐crest
-
藤野 毅
立命館大 理工
-
藤野 毅
立命館大学
-
堀 遼平
立命館大学大学院 理工学研究科
-
吉川 雅弥
名城大学理工学研究科情報工学専攻
-
吉川 雅弥
名城大学理工学研究科
-
堀 遼平
立命館大学 理工学部
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