ビアプログラマブルロジックデバイスVPEXにおける自動配置ツールの開発と性能評価(学生・若手研究会)
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概要
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我々は電子ビームによって2層のビアレイアウト(第1ビア層,第3ビア層)を描画することで,マスク制作費用を必要とせずにデジタル回路の論理を変更できるプログラマブルデバイスVPEX(Via Programmable logic using Exclusive or array)の研究を行っている.VPEXの基本論理素子(LE:Logic Element)は,複合ゲート型Exclusive-OR(EXOR)とInverter(INV)から構成されており,第1ビア層の変更によりすべての2入力論理を含む12種類の論理を出力する事ができる.また複数LEを用いてリセット付きスキャンDフリップフロップを構成する事ができるため,個別にDFFを用意する必要がなく,面積使用効率の上昇に繋がる.VPEX内の配線には第3メタル(M3)と第4メタル(M4)を使用するため,第3ビア層の変更することで配線変更を実現する.VPEX上に所望の回路を実現するためには,専用のCADシステムが必要となる.本論文では,VPEXの基本アーキテクチャとCADシステムについて説明するとともに,独自開発した自動配置ツールについて述べる.
- 社団法人電子情報通信学会の論文
- 2008-12-04
著者
-
藤野 毅
立命館大学理工学部
-
石橋 宏太
立命館大学大学院理工学研究科
-
吉川 雅弥
名城大学理工学部
-
川原崎 正英
立命館大学院理工学研究科
-
國生 雄一
立命館大学院理工学研究科
-
北村 一真
立命館大学院理工学研究科
-
西本 智弘
立命館大学院理工学研究科
-
石橋 宏太
立命館大学院理工学研究科
-
北村 一真
立命館大学
-
藤野 毅
立命館大学vlsiセンター
-
吉川 雅弥
Jst‐crest
-
藤野 毅
立命館大 理工
-
吉川 雅弥
名城大学理工学研究科情報工学専攻
-
藤野 毅
立命館大
-
吉川 雅弥
名城大学理工学研究科
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