吉川 雅弥 | Jst‐crest
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概要
関連著者
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吉川 雅弥
Jst‐crest
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吉川 雅弥
名城大学理工学部
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寺井 秀一
立命館大学理工学研究科
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藤野 毅
立命館大学理工学部
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寺井 秀一
立命館大学院理工学研究科
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藤野 毅
立命館大学
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吉川 雅弥
名城大学理工学研究科情報工学専攻
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吉川 雅弥
名城大学理工学研究科
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寺井 秀一
立命館大学総合理工学研究機構
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寺井 秀一
立命館大学
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藤野 毅
立命館大学vlsiセンター
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藤野 毅
立命館大 理工
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吉川 雅弥
立命館大学総合理工学研究機構
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吉川 雅弥
立命館大学 総合理工学研究機構 VLSIセンター
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堀 遼平
立命館大学院理工学研究科
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北森 達也
立命館大学院理工学研究科
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堀 遼平
立命館大学大学院理工学研究科
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北森 達也
立命館大学大学院理工学研究科
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堀 遼平
立命館大学大学院 理工学研究科
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北森 達也
立命館大学大学院 理工学研究科
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堀 遼平
立命館大学 理工学部
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浅井 稔也
名城大学理工学部情報工学科
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汐崎 充
広島大学大学院先端物質科学研究科
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北森 達也
立命館大学理工学部
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上岡 泰輔
立命館大学理工学部
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上岡 泰輔
立命館大学 理工学部
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汐崎 充
立命館大学
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國生 雄一
立命館大学院理工学研究科
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西本 智広
立命館大学院理工学研究科
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山田 翔太
立命館大学院理工学研究科
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汐崎 充
立命館大学総合理工学研究機構
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吉川 雅弥
名城大学理工学部情報工学科
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金光 亮輔
立命館大学理工学研究科
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尾藤 彰訓
立命館大学理工学研究科
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落合 真和
立命館大学大学院理工学研究科
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吉川 雅弥
名城大学 理工学部
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石橋 宏太
立命館大学大学院理工学研究科
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川原崎 正英
立命館大学院理工学研究科
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北村 一真
立命館大学院理工学研究科
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尾関 剛
立命館大学理工学研究科
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石橋 宏太
立命館大学院理工学研究科
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吉田 直之
立命館大学院理工学研究科
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松本 直樹
立命館大学理工学研究科
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松本 直樹
立命館大学院理工学研究科
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北村 一真
立命館大学
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吉田 直之
立命館大学大学院理工学研究科
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松本 直樹
立命館大学大学院理工学研究科
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吉川 雅弥
名城大学
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浅井 稔也
名城大学
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福井 正博
立命館大学理工学部
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松本 光崇
立命館大学大学院理工学研究科
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中野 裕文
株式会社ルネサステクノロジ
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岩男 剛宜
株式会社ルネサステクノロジ
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奥野 義弘
株式会社ルネサステクノロジ
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有本 和民
株式会社ルネサステクノロジ
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泉 知論
立命館大学大学院理工学研究科
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有本 和民
立命館大学理工学部
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泉 知論
立命館大学
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築山 修治
中央大学大学院理工学研究科
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築山 修治
中央大学理工学部電気電子情報通信工学科
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福井 正博
立命館大学電気情報デザイン学科
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山田 亮
立命館大学
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田中 祥幸
立命館大学理工学部
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吉田 和生
立命館大学
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原田 隆史
立命館大学院理工学研究科
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西本 智弘
立命館大学院理工学研究科
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石山 直幸
立命館大学院理工学研究科
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前田 哲広
立命館大学大学院理工学研究科
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国重 裕史
立命館大学院理工学研究科
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中村 峰幸
立命館大学
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嶋本 俊彦
立命館大学
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香川 憲市
立命館大学理工学研究科
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泉 知諭
立命館大学大学院理工学研究科
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井上 勇気
立命館大学理工学研究科
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福井 正博
立命館大学
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福井 正博
立命館大 理工
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築山 修治
中央大学理工学研究科
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汐崎 充
独立行政法人科学技術振興機構,CREST
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藤野 毅
独立行政法人科学技術振興機構,CREST
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中野 博文
ルネサスエレクトロニクス
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三木 陽生
立命館大学大学院理工学研究科
-
三木 陽正
立命館大学大学院理工学研究科
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福井 正博
立命館大学 理工学部 電子情報デザイン学科
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浅井 稔也
名城大学 理工学部 情報工学科
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石山 直幸
立命館大学院 理工学研究科
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福井 正博
立命館大学大学院理工学研究科
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大谷 拓
立命館大学理工学部
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大谷 拓
立命館大学大学院理工学研究科
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藤野 毅
立命館大
著作論文
- アントコロニー最適化手法の専用ハードウェアの設計と評価(「Webインテリジェンス」及び一般)
- LC-007 アントコロニー最適化アルゴリズム専用ハードウェア(ハードウェア・アーキテクチャ)
- リアルタイムGAをめざすGAプロセッサ・アーキテクチャと要素プロセッサのVLSI設計
- プログラマブルロジックePLXの自動マッピングツールの開発とローカルアーキテクチャ検討(リコンフィギャラブルシステム1,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
- C-003 遺伝的アルゴリズムによるアナログIC自動レイアウトシステム(C.アーキテクチャ・ハードウェア)
- ビアプログラマブルデバイスVPEXのチップ評価とDES暗号回路実装の検討(暗号処理回路,システムオンシリコンを支える設計技術)
- ビアプログラマブルロジックデバイスVPEXにおける自動配置ツールの開発と性能評価(学生・若手研究会)
- 体内コンピュータプロジェクト:生体内機器のためのLSI開発 (第21回 回路とシステム軽井沢ワークショップ論文集) -- (SoCの医療とロボット分野への応用)
- C-007 GAを用いたフロアプラン専用エンジンの設計と試作(C分野:ハードウェア・アーキテクチャ)
- A-004 ウイルス進化論を用いた経路探索システムの開発と実装(A分野:モデル・アルゴリズム・プログラミング)
- 免疫アルゴリズムをベースとするNSP専用エンジンアーキテクチャとその評価
- 免疫アルゴリズムアクセラレータの設計(回路技術(一般, 超高速・低電力・高機能を目指した新アーキテクチャ))
- F-002 動的環境に適応する自律学習システムの一考察(F分野:人工知能・ゲーム)
- C-037 ソフトウェア・ハードウェア連動配置手法(C分野:アーキテクチャ・ハードウェア)
- 進化的手法による高速学習を実現する専用エンジンアーキテクチャ
- シーケンスペアに基づく交叉専用アーキテクチャの設計(応用1, FRGAとその応用及び一般)
- クロストークノイズの低減を指向した配置手法(設計・検証, FRGAとその応用及び一般)
- シーケンスペアに基づく交叉専用アーキテクチャの設計(応用1, FRGAとその応用及び一般)
- クロストークノイズの低減を指向した配置手法(設計・検証, FRGAとその応用及び一般)
- シーケンスペアに基づく交叉専用アーキテクチャの設計(応用1, FRGAとその応用及び一般)
- クロストークノイズの低減を指向した配置手法(設計・検証, FRGAとその応用及び一般)
- 遺伝的アルゴリズムに基づくフロアプラン専用エンジンアーキテクチャとその評価
- ビアプログラマブルデバイスVPEXの配線遅延評価(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
- ビアプログラマブルデバイスに最適な基本論理ゲートアーキテクチャの検討(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
- ビアプログラマブルデバイスVPEXのロジックアレイブロックと配線アーキテクチャの検討(プログラマブルデバイスと設計技術,システムオンシリコンを支える設計技術)
- ビアプログラマブルストラクチャードASIC・VPEXの新アーキテクチャ提案と性能評価(ドライバ回路と新アーキテクチャ,デザインガイア2010-VLSI設計の新しい大地-)
- ビアプログラマブルストラクチャードASIC・VPEXの新アーキテクチャ提案と性能評価(ドライバ回路と新アーキテクチャ,デザインガイア2010-VLSI設計の新しい大地)
- ハードウェアアクセラレータを用いたロボットの行動獲得に関する一考察
- C-002 免疫システムアーキテクチャとその評価(C.アーキテクチャ・ハードウェア)
- 低消費電力を指向したパフォーマンスドリブン配置手法とその評価
- Crosstalk aware配置手法とその評価
- 免疫応答システム専用エンジンとその評価
- 相対位置制約を考慮したフロアプランニング手法
- ビアプログラマブルデバイスVPEXにおける配線リソースと配線遅延の評価(アーキテクチャ設計2,システムオンシリコンを支える設計技術)
- ビアプログラマブルASICアーキテクチャVPEX3の面積と遅延評価(アーキテクチャ設計2,システムオンシリコンを支える設計技術)
- 悪意ある攻撃から機密情報を守る耐タンパLSI設計手法(ディペンダブルコンピューティングシステム及び一般)
- 悪意ある攻撃から精密情報を守る耐タンパLSI設計手法(ディペンダブルコンピューティングシステム及び一般)
- 改良リングオシレータPUFのFPGA実装とその評価(ネットワークプロセッサ,通信のための信号処理,無線LAN/PAN,一般)
- 改良リングオシレータPUFのFPGA実装とその評価(ネットワークプロセッサ,通信のための信号処理,無線LAN/PAN,一般)
- 改良リングオシレータPUFのFPGA実装とその評価(ネットワークプロセッサ,通信のための信号処理,無線LAN/PAN,一般)
- 上流設計工程でのサイドチャネル攻撃に対する耐タンパ検証手法とその評価
- ビア信頼性を考慮した電源配線最適化手法(VLSI設計技術とCAD)
- 多重化ユニットを用いた物理的複製不可能関数とその実装評価
- 悪意ある攻撃から機密情報を守る耐タンパLSI設計手法
- ビアプログラマブルロジックVPEXのソフトエラー率の検討(ポスター講演,ポスターセッション,学生・若手技術者育成のための研究会)
- 多重化ユニットを用いた物理的複製不可能関数とその実装評価
- 統計補正処理を用いた経路選択リングオシレータPUFとその実装評価
- 上流設計工程でのサイドチャネル攻撃に対する耐タンパ検証手法とその評価
- ビアプログラマブルASICアーキテクチャVPEXの消費電力評価と面積・遅延性能評価(電力/電源解析,システムオンシリコンを支える設計技術)