川原崎 正英 | 立命館大学院理工学研究科

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概要

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関連著者

• 藤野 毅

  立命館大学理工学部

• 川原崎 正英

  立命館大学院理工学研究科

• 藤野 毅

  立命館大学vlsiセンター

• 藤野 毅

  立命館大学

• 西本 智弘

  立命館大学院理工学研究科

• 中村 明博

  立命館大学大学院理工学研究科

• 下林 義明

  立命館大学理工学部

• 吉川 雅弥

  名城大学理工学部

• 西本 智広

  立命館大学院理工学研究科

• 國生 雄一

  立命館大学院理工学研究科

• 北村 一真

  立命館大学院理工学研究科

• 北村 一真

  立命館大学

• 吉川 雅弥

  Jst‐crest

• 藤野 毅

  立命館大 理工

• 吉川 雅弥

  名城大学理工学研究科情報工学専攻

• 吉川 雅弥

  名城大学理工学研究科

• 長谷川 英司

  立命館大学理工学部

• 石橋 宏太

  立命館大学大学院理工学研究科

• 山田 翔太

  立命館大学院理工学研究科

• 石橋 宏太

  立命館大学院理工学研究科

• 寺川 知宏

  立命館大学理工学部

• 藤野 毅

  立命館大

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著作論文

• ビアプログラマブルデバイスVPEXのチップ評価とDES暗号回路実装の検討(暗号処理回路,システムオンシリコンを支える設計技術)
• ビアプログラマブルロジックデバイスVPEXにおける自動配置ツールの開発と性能評価(学生・若手研究会)
• ビアプログラマブルデバイスVPEXのロジックエレメント改良による面積削減と高性能化(学生・若手研究会)
• EB直描を使ったマスクレスビアプログラマブルデバイスVPEXの提案と回路性能評価(回路方式,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
• EB直描を使ったマスクレスビアプログラマブルデバイスVPEXの提案と回路性能評価(回路方式,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
• EB直描を使ったマスクレスビアプログラマブルデバイスVPEXの提案と回路性能評価(回路方式,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)

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