FPGA実装された暗号回路に対するビット値に着目した電力差分解析(DPA)実験(暗号処理回路,システムオンシリコンを支える設計技術)
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概要
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サイドチャネル攻撃評価用FPGAボード(SASEBO)とオシロスコープを使用すると,ブロック暗号回路動作時の消費電力の統計解析による鍵の推定,すなわち差分電力解析(DPA)を比較的容易に実証実験できる.しかしながら,FPGAボードでDES暗号回路を実装した場合,選択関数としてS-Boxの入出力ビットの値を使用する「ビット値型DPA」による鍵推定は困難であると言われており,一般にはラウンド間でのレジスタの遷移を選択関数とする「ビット遷移型DPA」が用いられる.本研究では,FPGA上のS-Box回路を構成する際に,ASICと同じプリミティブゲートを用いて実装する手法を導入したことによりFPGAボード上でも「ビット値型DPA」が成功することを確認した.またビット遷移型DPAに対してはランダムマスク併用S-Box入力初期化対策が有効であることを確認したので報告する.
- 2009-03-04
著者
-
奥山 一樹
立命館大学大学院理工学研究科
-
小島 憲司
立命館大学理工学部
-
牧野 友輝
立命館大学理工学部
-
藤野 毅
立命館大学理工学部
-
藤野 毅
立命館大学vlsiセンター
-
小島 憲司
立命館大学大学院理工学研究科
-
藤野 毅
立命館大学
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