連想メモリを搭載したハードウェアエンジンによる故障回路並列故障シミュレーションの高速化手法
スポンサーリンク
概要
- 論文の詳細を見る
連想メモリ (CAM: Content Addressable Memory) を搭載したハードウェアエンジンを用いて故障回路並列の故障シミュレーションを実行することにより, シミュレーション時間が逐次型計算機を利用した場合に比べて短縮されることが知られている. これは, 連想メモリの一致検索機能や並列書き込み機能等を利用することで, 全故障回路を連想メモリ上で並列にシミュレーションできるためである. しかしながら, 対象とする回路が大規模化すると, 全故障回路を連想メモリ上に同時に記憶できないことがある. 従来, 全故障回路を連想メモリ上に一度に記憶可能な数毎に分割して処理していたが, その際に必要となる連想メモリとホストコンピュータとの通信がボトルネックとなり, シミュレーション速度向上の妨げとなっていた. 本稿では, 連想メモリを搭載したハードウェアエンジン上に通信用RAMを設けることで, ホストコンピュータとの通信による遅延を削減する手法を提案し計算機による提案手法の評価結果を報告する.
- 社団法人電子情報通信学会の論文
- 1997-10-29
著者
関連論文
- 歩行者の現在地認識に基づく道路標識とランドマークを用いた位置特定システムの改良とシミュレーション評価(ITS画像処理,映像メディア,視覚および一般)
- 1.メディア処理における超低消費電力SoC技術(未来を切り拓く最先端VLSIテクノロジー)
- ビットレベル処理を考慮したセレクタ帰着型重み付き加算器(システムレベル設計,システム設計及び一般)
- 命令メモリビット幅削減に基づく低エネルギーASIP合成手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
- アドホックネットワークにおけるクラスタの接続性とクラスタヘッドの負荷分散を考慮したルーティング (アドホックネットワーク)
- セレクタ論理を用いた高速な差積演算器の設計とバタフライ演算への応用
- 組み込みシステムの2階層キャッシュとスクラッチパッドメモリのシミュレーション手法(システムレベル設計,デザインガイア2008-VLSI設計の新しい大地)
- 組み込みシステムの2階層キャッシュとスクラッチパッドメモリのシミュレーション手法(システムレベル設計,デザインガイア2008-VLSI設計の新しい大地-)
- アプリケーションプロセッサのL1データキャッシュ最適化手法(プロセッサ向け最適化と開発環境)
- フロアプランを考慮した高位合成のための高速なモジュール配置手法(高位合成,FPGA応用及び一般)
- 屋内環境におけるユーザの経路嗜好調査とこれに基づく経路探索手法(ITSポジショニングシステム,一般)
- H.264/AVC符号化向けDSPにおける動き予測演算器の設計(信号処理,LSI,及び一般)
- 複数のグループを持つ無線アドホックネットワークにおける衝突回避型マルチキャストプロトコル (アドホックネットワーク)
- 進路方向によって異なる混雑度を考慮した旅行時間算出手法(交通における計測・一般)
- 車車間・路車間通を用いた車線別の渋滞情報の検出手法(交通における計測・一般)
- 車車間・路車間通を用いた車線別の渋滞情報の検出手法
- ディジタルメディア向け動的再構成型プロセッサFE-GAへのDFGマッピングとその自動化手法(動的再構成システム,物理設計及び一般)
- IEEE802.11nに対応した高効率列処理演算器による高スループットイレギュラーLDPC復号器の実装と評価(動的再構成システム,物理設計及び一般)
- 連携処理を考慮したネットワークプロセッサへの処理割り当て手法(ネットワークオンチップ,システムオンシリコンを支える設計技術)
- Odd-Even Turn Modelを対象としたNoCの負荷分散による遅延時間削減手法(ネットワークオンチップ,システムオンシリコンを支える設計技術)
- アプリケーションプロセッサのための高速かつ最適なパイプライン構成を持つSIMD演算ユニット合成手法(高位合成,FPGA応用及び一般)
- 組み込みシステム向けMPSoCのためのマルチレイヤ構造をとるバスアーキテクチャ最適化手法(システムレベル設計,FPGA応用及び一般)
- 命令メモリアクセス数削減に基づく低エネルギーASIP合成手法(システムレベル設計,FPGA応用及び一般)
- FPGAを用いた動的再構成可能システムと暗号化アルゴリズムへの応用
- 楕円曲線暗号に適したGF(2^m)上のSIMD型MSD乗算器の設計(システム設計及び一般)
- 楕円曲線暗号に適したGF(2^m)上のSIMD型MSD乗算器の設計(算術演算回路,システム設計及び一般)
- ビットレベル式変形によるセレクタ帰着型バタフライ演算器の設計と評価(高位合成及び演算器設計,物理設計及び一般)
- セレクタ論理を用いたバタフライ演算器の設計(合成及び演算器最適化,システム設計及び一般)
- セレクタ論理を用いたバタフライ演算器の設計(システム設計及び一般)
- 歩行者の現在地認識に基づく道路標識とランドマークを用いた位置特定システムの改良とシミュレーション評価
- GF(2^n)及びGF(P)におけるスケーラブル双基数ユニファイド型モンゴメリ乗算器(信号処理,LSI,及び一般)
- 楕円曲線暗号向けGF(2^m)上のDigit-Serial乗算器の設計(FPGAとその応用及び一般)
- 楕円曲線暗号向けGF(2^m)上の Digit-Serial 乗算器の設計
- 歩行者の現在地認識に基づく道路標識とランドマークを用いた位置特定システムの改良とシミュレーション評価(ITS画像処理,映像メディア,視覚及び一般)
- 組み込みアプリケーションを対象とした2階層ユニファイドキャッシュのシミュレーション手法(システム設計,デザインガイア2009-VLSI設計の新しい大地-)
- アプリケーションプロセッサのカーネル記述自動生成手法(プロセッサ向け最適化と開発環境)
- アプリケーションプロセッサのカーネル記述自動生成手法(プロセッサ向け最適化と開発環境,FPGA応用及び一般)
- 動的フローに適応したネットワークプロセッサの改良とその評価(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 歩行者向けデフォルメ地図生成ハードウェアエンジンの設計(FPGA/設計事例,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
- 認知科学を応用した微小画面向け略地図生成手法とその統計的評価(高度交通システム(ITS))
- 進路方向によって異なる混雑度を考慮した旅行時間算出手法(交通における計測・一般)
- 車車間・路車間通を用いた車線別の渋滞情報の検出手法(交通における計測・一般)
- 道路標識とランドマークを用いた歩行者位置特定システムと実地調査による評価
- 2階層キャッシュメモリにおけるシミュレーションベースのバス幅最適化手法(システム設計,デザインガイア2009-VLSI設計の新しい大地-)
- 組み込みシステム向けMPSoCのためのマルチレイヤ構造をとるバスアーキテクチャ最適化手法(システムレベル設計,FPGA応用及び一般)
- 命令メモリアクセス数削減に基づく低エネルギーASIP合成手法(システムレベル設計,FPGA応用及び一般)
- フロアプランを考慮した高位合成のための高速なモジュール配置手法(高位合成,FPGA応用及び一般)
- フロアプランを考慮した高位合成のための高速なモジュール配置手法(高位合成,FPGA応用及び一般)
- フロアプランを考慮した高位合成のための高速なモジュール配置手法(高位合成,FPGA応用及び一般)
- 制御処理ハードウェアの高位合成システムのための面積/時間最適化アルゴリズム
- 命令メモリビット幅削減に基づく低エネルギーASIP合成手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 一般化レジスタ分散アーキテクチャを対象とした高位合成手法とその評価(システム設計とその最適化I,システム設計及び一般)
- 常時着用型センサ"ビジネス顕微鏡"による組織変革(システムオンシリコンを支える設計技術)
- 歩行者の現在地認識に基づく道路標識とランドマークを用いた位置特定システムの改良とシミュレーション評価(ITS画像処理,映像メディア,視覚及び一般)
- 部分マッチングを考慮しMISO構造に対応した専用演算器合成手法(演算器最適化設計,FPGA応用及び一般)
- 部分マッチングを考慮しMISO構造に対応した専用演算器合成手法(演算器最適化設計,FPGA応用及び一般)
- 部分マッチングを考慮しMISO構造に対応した専用演算器合成手法(演算器最適化設計,FPGA応用及び一般)
- 2階層キャッシュメモリにおけるシミュレーションべースのバス幅最適化手法(システム設計,デザインガイア2009-VLSI設計の新しい大地)
- 組み込みアプリケーションを対象とした2階層ユニファイドキャッシュのシミュレーション手法(システム設計,デザインガイア2009-VLSI設計の新しい大地)
- セレクタ論理を用いた高速な差積演算器の設計とバタフライ演算への応用
- 設計ナビゲーション機構を有するシステムLSI設計のためのHW/SW分割システム(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 設計ナビゲーション機構を有するシステムLSI設計のためのHW/SW分割システム(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 節点がレベル付けされたグラフの最小枝交差描画問題に関する一考察
- BDDを用いたマンハッタン配線問題の解法
- 組み込みシステムの2階層キャッシュとスクラッチパッドメモリのシミュレーション手法(システムレベル設計,デザインガイア2008-VLSI設計の新しい大地)
- SIMD型プロセッサコアの面積/遅延見積り
- HW/SW協調合成におけるアプリケーションプロセッサの面積/遅延見積もり手法(信号処理,LSI,及び一般)
- HW/SW協調合成におけるアプリケーションプロセッサの面積/遅延見積もり手法(信号処理,LSI,及び一般)
- HW/SW協調合成におけるアプリケーションプロセッサの面積/遅延見積もり手法(信号処理,LSI,及び一般)
- FPGAを用いた動的再構成可能システムとその応用
- FPGAを用いた動的再構成可能システムとその応用
- レジスタ分散型アーキテクチャを対象とするフロアプランとタイミング制約を考慮した高位合成手法(動作合成, システムLSIの設計技術と設計自動化)
- 歩行者ナビゲーションにおける携帯電話カメラ機能とランドマークを利用した位置補正手法(交通における計測・一般)
- 歩行者ナビゲーションにおける携帯電話カメラ機能とランドマークを利用した位置補正手法
- 歩行者ナビゲーションにおける携帯電話カメラ機能とランドマークを利用した位置補正手法(交通における計測・一般)
- FPGA を対象とした階層的概略詳細配線手法
- 列処理演算法に着目したマルチレート対応イレギュラーLDPC符号復号器(符号化と演算,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
- FIFOをキャッシュ置換ポリシとする正確なキャッシュ構成シミュレーションの高速化(プロセッサ設計,デザインガイア2010-VLSI設計の新しい大地-)
- FIFOをキャッシュ置換ポリシとする正確なキャッシュ構成シミュレーションの高速化(プロセッサ設計,デザインガイア2010-VLSI設計の新しい大地-)
- アプリケーションプロセッサのための高速かつ最適なパイプライン構成を持つSIMD演算ユニット合成手法(高位合成,FPGA応用及び一般)
- アプリケーションプロセッサのための高速かつ最適なパイプライン構成を持つSIMD演算ユニット合成手法(高位合成,FPGA応用及び一般)
- アプリケーションプロセッサのための高速かつ最適なパイプライン構成を持つSIMD演算ユニット合成手法(高位合成,FPGA応用及び一般)
- ルータの負荷分散と制御パケット数削減を目的としたエニーキャスト経路選択手法(フォトニックネットワークシステム,光ルーティング,ブロードバンドアプリケーション,一般)
- エニーキャストにおけるルータの負荷に基づく経路選択手法((フォトニック)IPネットワーク技術,(光)ノード技術,WDM技術,信号処理技術,一般)
- 制御処理ハードウェアの高位合成システムにおける面積/遅延見積もり手法
- 命令メモリアクセス数削減に基づく低エネルギーASIP合成手法(システムレベル設計,FPGA応用及び一般)
- 命令メモリアクセス数削減に基づく低エネルギーASIP合成手法(システムレベル設計,FPGA応用及び一般)
- 屋内用歩行者ナビゲーションにおける歩行者の嗜好を反映させる経路探索手法
- 屋内用歩行者ナビゲーションにおける歩行者の嗜好を反映させる経路探索手法(交通における計測・一般)
- 屋内用歩行者ナビゲーションにおける歩行者の嗜好を反映させる経路探索手法(交通における計測・一般)
- 特集「組込みシステム工学」の編集にあたって
- 5. FPGA 用のレイアウト手法 (<特集> FPGA : その現状、将来とインパクト)
- 組み込みシステム向けMPSoCのためのマルチレイヤ構造をとるバスアーキテクチャ最適化手法(システムレベル設計,FPGA応用及び一般)
- 組み込みシステム向けMPSoCのためのマルチレイヤ構造をとるバスアーキテクチャ最適化手法(システムレベル設計,FPGA応用及び一般)
- A-3-6 RSA暗号に対するスキャンベース攻撃の評価実験(A-3.VLSI設計技術,一般セッション)
- SIMD型プロセッサコアの自動合成のためのパイプライン演算ユニット生成手法(アーキテクチャ生成,システムLSI設計とその技術)
- FPGAを用いた動的再構成可能システムと暗号化アルゴリズムへの応用
- 進路方向によって異なる混雑度を考慮した旅行時間算出手法
- 道路ネットワーク分割に基づく高速エリア略地図生成手法(ITSポジショニングシステム,一般)
- ディジタル信号処理向けプロセッサの自動合成システムにおける並列化コンパイラ