プレスブルガー文真僞判定手続きを用いた算術演算回路の正しさの証明
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概要
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加算器, 乗算器, ALUなど, 算術演算を行う組み合わせ論理回路が,そのワードレベル仕様F(整数上の論理式として書かれた入出力関係の記述)を正しく実現している事を, プレスブルガー文真偽判定手続きを用いて自動証明する方法と, 証明例について述べる。証明は, いわゆるビットレベル検証(各回路モジュールM_jごと,そのワードレベル仕様,F_jがゲートレベルで正しく実現されていることの証明)とワードレベル検証(各M_jの接続関係および各ワードレベル仕様F_jのもとで, Fが満たされることの証明)に分けて行う。算術など, プレスブルガー算術で直接扱えない演算を行う回路についても, その演算に関して数学的に成り立つ性質等を仮定することにより, 証明できる場合がある。本手法の特徴は, 幾つかの工夫を行ったプレスブルガー真偽判定ルーチンを用いることにより, 各モジュールの演算ビット長nが増えても, 回路中のモジュールの数や組合せ方が同じで, かつ仕様記述のサイズがnに依存していなければ, ワードレベル検証にかかる時間がほとんど増加しないことである。例えばnビット乗算器から2nビット乗算器を構成した場合のワードレベル検証を, 2分程度のCPU時間で行えた。ピットレベル検証についても,演算ビット長が4ビット程度であれば, 例えば加減算・論理演算を行うALU (74382)について6分程度のCPU時間で行えた。
- 一般社団法人情報処理学会の論文
- 1996-10-17
著者
-
柴田 直樹
大阪大学大学院基礎工学研究科情報数理系専攻
-
東野 輝夫
大阪大学基礎工学部情報科学科
-
谷口 健一
大阪大学基礎工学部情報科学科
-
森岡 澄夫
大阪大学基礎工学部情報学科
-
東野 輝夫
大阪大学大学院情報科学研究科|独立行政法人科学技術振興機構 Crest
-
柴田 直樹
大阪大学基礎工学部情報工学科
-
森岡 澄夫
大阪大学大学院基礎工学研究科情報数理系専攻:(現)日本アイ・ビー・エム株式会社
-
谷口 健一
大阪大学基礎工学部情報工学科
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