代数的手法を用いたCPU KUE-CHIP2の段階的設計およびその正しさの証明
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概要
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従来から我々が提案している代数的手法を用いた順序回路の設計法, 検証法や支援システムの有用性を調べるため, 教育用CPU KUE-CHIP2を要求仕様から段階的に設計し,その正しさの証明を行った. 我々の証明支援系は作業の自動化をめざしており, 本例題ではほとんどの部分が自動で行えた. 設計では最適化(命令プリフェッチ)も行い, SFL記述へ自動変換し, パルテノンで回路(ネットリスト)を得た. 設計と証明の作業時間も2週間程度であり, 設計法や証明支援システムが実用上有用であると思われる.
- 一般社団法人情報処理学会の論文
- 1996-02-09
著者
-
東野 輝夫
大阪大学基礎工学部情報科学科
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谷口 健一
大阪大学基礎工学部情報科学科
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森岡 澄夫
大阪大学基礎工学部情報学科
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東野 輝夫
大阪大学大学院情報科学研究科|独立行政法人科学技術振興機構 Crest
-
森岡 澄夫
大阪大学大学院基礎工学研究科情報数理系専攻:(現)日本アイ・ビー・エム株式会社
-
島谷 肇
大阪大学大学院基礎工学研究科情報数理系専攻:(現)株式会社東芝
-
谷口 健一
大阪大学基礎工学部情報工学科
-
北嶋 暁
大阪電気通信大学総合情報学部メディアコンピュータシステム学科
-
北嶋 暁
大阪大学基礎工学部情報科学科
-
島谷 肇
大阪大学基礎工学部情報工学科
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