整数上の論理式の恒真性判定アルゴリズムを用いた組合せ論理回路の実現の正しさの証明
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概要
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組合せ論理回路が任意の入力に対して正しい演算結果を出力することを,機械的に証明できることが望ましい.本稿では、整数演算を行う回路の仕様(回路が行うべき演算)と実現(論理ゲートの結線)をそれぞれ整数上の論理式で記述し,実現が仕様を満たすことを整数上の論理式の真偽判定アルゴリズムを用いて証明した例を示す.整数演算や論理演算を行う組み合わせ論理回路の仕様は,比較や加減算を用いた整数上の論理式により,自然に分かりやすく記述できる.また,整数上の論理式の真偽判定アルゴリズムにより,仕様をプール代数の式で与える場合とは異なり,回路出力が例えば加算等の演算結果になっていることを直接証明できる.今回,整数上の論理式の真偽判定ルーチンを,組合せ論理回路の検証用に工夫して実装した.そのルーチンにより,TTLの4ビットALU74382の正しさを4分程度で高速に証明できた.
- 一般社団法人情報処理学会の論文
- 1994-09-20
著者
-
北道 淳司
大阪大学大学院基礎工学研究科
-
東野 輝夫
大阪大学基礎工学部情報科学科
-
谷口 健一
大阪大学基礎工学部情報科学科
-
森岡 澄夫
大阪大学基礎工学部情報学科
-
東野 輝夫
大阪大学大学院情報科学研究科|独立行政法人科学技術振興機構 Crest
-
北道 淳司
大阪大学基礎工学部情報工学科
-
森岡 澄夫
大阪大学大学院基礎工学研究科情報数理系専攻:(現)日本アイ・ビー・エム株式会社
-
谷口 健一
大阪大学基礎工学部情報工学科
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