代数的手法を用いた複数の制御部を持つ同期式順序回路に対する設計および検証支援系の開発
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概要
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我々は代数的手法に基づく単一制御部回路の段階的な設計支援系及び検証支援系を開発してきた[1,2]. 高位レベルにおける設計及び検証を対象とする本支援系では, 回路を状態遷移図としてモデル化している. 設計支援系はいわゆる状態遷移図エディタである. この回路上で, 機能検証(入力値と出力値の間, あるいは指定された状態において各レジスタの保持する値の間において指定された関係を満たすことなど)を行うために, 検証者が不変式(各レジスタが保持する値の間に常に成り立つ関係式)及び補題などを設定する機能や, 項書換え系など代数的な定理証明機能が用意されている. 設計者は, 検証時に必要とされる各レジスタの値の関係を念頭において, 回路設計を行っている考えられる. そこで本稿では検証機能を含む設計支援系を提案する. さらに複数の制御部を持つ回路に対応するように拡張した.
- 社団法人電子情報通信学会の論文
- 1997-03-06
著者
-
北道 淳司
大阪大学大学院基礎工学研究科
-
西川 清史
大阪大学大学院基礎工学研究科情報数理系専攻
-
竹中 崇
大阪大学大学院基礎工学研究科情報数理系専攻
-
斎藤 義勝
大阪大学大学院 基礎工学研究科 情報数理系専攻
-
竹中 崇
大阪大学大学院情報科学研究科:(現)necマルチメデイア研究所
-
西川 清史
大阪大学大学院基礎工学研究科
-
竹中 崇
日本電気株式会社システムIPコア研究所
-
西川 清史
大阪大学大学院基礎光学研究科情報数理系専攻
-
竹中 崇
日本電気株式会社
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