マルチアクセラレータ型動的再構成プロセッサの実装(FPGAアクセラレーター,FPGA応用及び一般)
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概要
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近年のSystem on a Chip(SoC)において,特定の機能に特化した多種の専用ハードウェアの搭載による実装面積や設計コストが増加している問題を,再構成デバイスを用いてシステムの動作中に構成を動的に変更することにより解決することが期待されている.本研究では,XILINX社の一部のFPGAに搭載されている動的部分再構成機能を用い,アクセラレータ型動的再構成プロセッサシステムを提案する.本稿では,複数のアクセラレータを複数の領域に部分再構成するプロセッサシステムを実装し,実装面積と再構成時間について評価した.
- 社団法人電子情報通信学会の論文
- 2011-01-10
著者
-
奥山 祐市
会津大学大学院コンピュータ理工学研究科
-
北道 淳司
会津大学大学院コンピュータ理工学研究科
-
黒田 研一
会津大学大学院コンピュータ理工学研究科
-
奥山 祐市
会津大学コンピュータ理工学部
-
北道 淳司
会津大学コンピュータ理工学部
-
北道 淳司
大阪大学大学院基礎工学研究科
-
北道 淳司
会津大学大学コンピュータ理工学研究科
-
猪狩 修平
会津大学大学院コンピュータ理工学研究科
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