代数的手法を用いた同期式順序回路の設計支援機能の統合
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概要
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我々は同期式回路の仕様記述,設計及び検証のための方法のひとつとして代数的手法を提案してきた[1,2].代数的手法では,仕様を厳密に形式的に記述することができ,また,設計の正しさの証明(検証)などを形式的に議論できる.代数的手法を用いた段階的な設計において,各レベルの仕様は状態遷移図で表すことができ,テキストで編集するより状態遷移図そのもので編集する方が,設計が直観的でわかりやすい場合が多い.本論文では,代数的手法に基づく設計のためにGUIを用いた設計支援システムを提案する.本システムでは階層的な設計を支援(管理)し,状態遷移図の作成や修正が行なえる.
- 社団法人電子情報通信学会の論文
- 1995-03-27
著者
-
北道 淳司
大阪大学大学院基礎工学研究科
-
谷口 健一
大阪大学基礎工学部情報科学科
-
森岡 澄夫
大阪大学基礎工学部情報学科
-
西川 清史
大阪大学大学院基礎工学研究科情報数理系専攻
-
北道 淳司
大阪大学基礎工学部情報工学科
-
西川 清史
大阪大学基礎工学部情報工学科
-
村上 尚
大阪大学基礎工学部情報工学科
-
森岡 澄夫
大阪大学大学院基礎工学研究科情報数理系専攻:(現)日本アイ・ビー・エム株式会社
-
西川 清史
大阪大学大学院基礎工学研究科
-
谷口 健一
大阪大学基礎工学部情報工学科
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