カスケード位相比較器を用いたミリ波PLLシンセサイザ(一般講演,パワーデバイス及び超高周波デバイス/マイクロ波一般)
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概要
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カスケード位相比較器を用いた新しいPLLアーキテクチャを提案する。このアーキテクチャは低位相雑音と低スプリアスを同時に実現することができる。このアーキテクチャに基づいた79GHz帯PLLシンセサイザを、65nm CMOSテクノロジを用いて開発した。試作した結果、非常に低い位相雑音-90.0dBc/Hz(オフセット周波数1MHz)を達成した。リファレンス発振器は、49MHzの水晶振動子を外付けにしたCMOS発振器である。また、リファレンス・スプリアスについて、離調周波数49MHzで-29.3dBc、98MHzで-36.0dBcの低スプリアス特性を確認した。
- 一般社団法人電子情報通信学会の論文
- 2014-01-09
著者
-
原 直紀
株式会社富士通研究所
-
大橋 洋二
富士通株式会社
-
川野 陽一
富士通株式会社
-
鈴木 俊秀
富士通株式会社
-
佐藤 優
富士通株式会社
-
大島 武典
富士通株式会社
-
松村 宏志
富士通株式会社グローバルアクセス事業部
-
志村 利宏
富士通株式会社
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