HDRアーキテクチャを対象とした複数電源電圧指向の低電力化高位合成手法(プロセッサ,DSP,画像処理技術及び一般)
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概要
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携帯機器の駆動時間や発熱が問題となる現代,低電力化を意識したLSI設計が必要である.半導体の微細化技術の向上のため,ゲート遅延に対する配線遅延の割合が増加し,配線遅延を考慮した設計も必要である.システムLSIの設計手法として高位合成があるが,低電力化と配線遅延の双方を意識した高位合成としてHDRアーキテクチャを対象とした複数電源電圧指向の高位合成がある.しかし,これはスケジューリング/FUバインディングの際,直接的に消費エネルギーを最小化するのではなく,実行時間の最小化を目的とすることで2次的に消費エネルギーを削減している.本稿では,HDRアーキテクチャを対象とした,複数電源電圧を考慮した消費エネルギーの最小化を目的とするスケジューリング/FUバインディングを提案する.計算機実験により提案手法は,従来のレジスタ分散型アーキテクチャと比較して最大45.1%程度消費エネルギーを削減でき,従来のHDRアーキテクチャを対象とした手法と比較して最大15.9%程度消費エネルギーを削減できることを確認した.
- 2011-10-17
著者
-
戸川 望
早稲田大学
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
柳澤 政生
早稲田大学理工学研究科
-
柳澤 政生
早稲田大
-
阿部 晋矢
早稲田大学大学院基幹理工学研究科情報理工学専攻
-
柳澤 政生
早大
-
柳澤 政生
早稲田大学
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