LUT型FPGA向けテクノロジ・マッピングにおける深さ制約下のLUT数削減手法(FPGA/設計事例,デザインガイア2007-VLSI設計の新しい大地を考える研究会-)
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概要
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本稿では,深さ最小の制約下でLUT数が少ないLUTネットワークを生成するLUT型FPGA向けテクノロジ・マッピングにおける,LUT数削減のための後処理Cut Substitutionを提案する.深さ最小の制約下でLUT数最小なネットワークを得る問題はNP困難なクラスと同等かそれ以上に難しい問題と考えられ,効率の良い厳密アルゴリズムは見つかっていない.Cut Substitutionは,LUTネットワークの深さを保ち余分なLUTを取り除くことで,局所的な最適解を生成する.提案手法と既存手法の比較実験を行い,提案手法の優位性を確認した.
- 一般社団法人情報処理学会の論文
- 2007-11-20
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