LUT型FPGAを対象とした消費電力および遅延の見積もり手法について(高速化/低消費電力化II,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
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概要
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FPGAの消費電力削減と性能向上を実現させるためには、アーキテクチャと回路合成技術の面から考えなければならない。本研究では、消費電力および遅延の削減を目的関数とする配置配線アルゴリズムの提案を目指している。本稿では、そのための基礎技術としてLUT型FPGAを対象とした消費電力および遅延の見積もり手法の提案を行い、精度の評価を行うためにNanosimによる見積もり結果との比較を行った。
- 社団法人電子情報通信学会の論文
- 2006-11-23
著者
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