イニシエーション・インターバルとアロケーションの制約下における総面積最小を目的としたパイプライン・スケジューリング手法(高位・論理合成,システムオンシリコンを支える設計技術)
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概要
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本稿では,パイプライン回路を対象とした動作合成における,スループット制約下での回路の総面積最小化を目的としたパイプラインスケジューリング手法を提案する.既存手法の多くがリソース制約とイニシエーション・インターバルの制約下でパイプラインスケジューリングを行うのに対して,提案手法ではアロケーションとイニシエーション・インターバルの制約下でパイプラインスケジューリングを行う.そのため,リソース制約が原因となって実行可能解が得られないという問題が発生しない.また,各演算を割り当て可能なクロックサイクルがリソース制約によって制限されないため,各種の演算器の面積とレジスタの面積を考慮し,回路の総面積が小さくなるようにパイプラインスケジューリングを行うことが可能である.実験の結果,提案手法は既存手法に対して回路の総面積を平均で約30%削減し,実行時間も実用の範囲内であった.
- 2009-03-04
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