SIMD型プロセッサコアの自動合成におけるパイプライン構成最適化手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
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概要
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本稿では,アプリケーションに特化したSIMD型プロセッサコアの自動合成において,合成されるプロセッサコアのパイプライン構成を最適化する手法を提案する.画像処理アプリケーションなどで頻繁に処理されるSIMD乗算や乗加算は演算実行遅延が大きくプロセッサの動作周波数を決定することが多い.SIMD演算を実行可能なSIMD型プロセッサコアの自動合成では,SIMD演算をマルチサイクル化することにより,少ない面積オーバーヘッドでより高速なプロセッサコア構成を得ることが期待できる.但し,ハザードの影響により必ずしもパイプライン段数を増やすことがアプリケーション実行時間の短縮につながるとは限らず,プロセッサコアの自動合成では与えられた実行時間制約の中で最適なパイプライン構成を探索するのが望ましい.提案手法では,まず段数の異なる複数のパイプライン構成を定義する.次に定義された全てのパイプライン構成について,与えられた実行時間制約を満たすように,付加するハードウェアユニットの種類と数を最適化する.最後に得られた全てのパイプライン構成の中で最も小面積の構成を選択し,最適なパイプライン構成として出力する.計算機実験により本手法の有効性を評価した.
- 社団法人電子情報通信学会の論文
- 2006-03-02
著者
-
戸川 望
早稲田大学
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
栗原 輝
早稲田大学理工学部コンピュータ・ネットワーク工学科
-
柳澤 政生
早稲田大学
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