強誘電体メモリを用いたReconfigurable Logicとその性能評価
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概要
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本論文では, 強誘電体不揮発性メモリを用いたReconfigurable Logicの基本ブロックアーキテクチャおよびその性能評価について述べる.本Reconfigurable Logicは, 、メモリセルにFeRAMを用いることにより, 電源供給停止後も論理構成用データを失われないという特長を持ち、携帯マルチメディア通信に向けたシステム・オン・チップ技術として適用可能である.基本アレイエレメントの性能評価の結果, 本Reconfigurable Logicは従来のDRAMに基づくReconfiguragle Logicと同等以上の性能を持つことを確認した.
- 社団法人電子情報通信学会の論文
- 1998-08-20
著者
-
大槻 達男
松下電子工業(株)電子総合研究所第三研究部
-
尾上 孝雄
大阪大学大学院情報科学研究科
-
密山 幸男
大阪大学大学院情報科学研究科
-
白川 功
大阪大学大学院工学研究科情報システム工学専攻
-
馬場 孝明
松下電子工業株式会社電子総合研究所
-
大槻 達男
松下電子工業株式会社技術本部
-
浅利 康二
大阪大学大学院情報システム工学専攻:松下電子工業株式会社技術本部
-
浅利 康二
大阪大学大学院情報システム工学専攻 : 松下電子工業株式会社技術本部
-
大槻 達男
松下電子工業(株)半導体社半導体デバイス研究センター
-
馬場 孝明
松下電子工業株式会社技術本部
-
尾上 孝雄
大阪大学大学院工学研究科情報システム工学専攻
-
密山 幸男
大阪大学大学院工学研究科
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