低電力、高速インパルス伝送型CMOSインタフェース回路
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概要
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従来の高速CMOSインタフェースは、終端抵抗と出力回路間に定常電流が流れるため、十数mWの電力を消費していた。伝送信号として、従来の2値信号ではなくインパルス信号を用いた新しいインタフェース回路を提案する。信号の変化の無い時は、出力回路をハイインピーダンス状態にして、定常電流を遮断する。入力回路では、シュミットトリガのヒステリシスを利用してインパルス信号をCMOS信号に変換する。0.5μm CMOSプロセスで試験チップを試作し、データレート156Mb/sにおいて従来の13%の消費電力、870Mb/sまでのエラーフリー伝送を確認した。ノイズ耐性を強化した設計を行っても、156Mb/sにおいて従来に35%程度の消費電力を実現できる。
- 社団法人電子情報通信学会の論文
- 1995-06-22
著者
-
井野 正行
Nttエレクトロニクステクノロジー
-
井野 正行
NTT LSI研究所
-
野河 正史
日本電信電話株式会社NTTマイクロシステムインテグレーション研究所
-
大友 祐輔
日本電信電話株式会社nttマイクロシステムインテグレーション研究所
-
大友 祐輔
NTT LSI研究所
-
野河 正史
NTT LSI研究所
-
大友 祐輔
Ntt マイクロシステムインテグレーション研
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