高速アクセス用10Gbit/s CMOSバーストモードクロックデータ再生IC(超高速・超高周波デバイス及びIC/一般)
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概要
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将来の超高速アクセスネットワークへの適用を目指し、10Gbit/s級バースト伝送用クロックデータ再生ICをCMOSプロセスを用いて試作した。一般にバースト伝送用のICは直流結合が基本となるが、本ICでは容量結合が可能な入力バッファを搭載し、さらにクロック再生回路のゲーティング回路に否定論理積回路を採用することでデューティー変動耐性を高めた。試作したICを搭載した評価基板は10.0Gbit/sの速度で連続信号と非同期パケット信号の双方に対してエラーフリー動作し、非同期パケット信号に対しては16ビット以下のプリアンブルで位相同期が取れることを確認した。また、入力信号のデューティーが44〜59%(PPGのデューティー可変幅上限)以上の範囲で動作し、消費電力は1.2Wであった。
- 2005-01-11
著者
-
西村 和好
NTTマイクロシステムインテグレーション研究所
-
大友 祐輔
NTTマイクロシステムインテグレーション研究所
-
雲崎 清美
NTTアクセスサービスシステム研究所
-
木村 俊二
日本電信電話株式会社NTTアクセスサービスシステム研究所
-
木村 俊二
NTTアクセスサービスシステム研究所
-
野河 正史
NTTマイクロシステムインテグレーション研究所
-
吉田 智暁
NTTアクセスサービスシステム研究所
-
西原 晋
NTTアクセスサービスシステム研究所
-
野河 正史
日本電信電話株式会社NTTマイクロシステムインテグレーション研究所
-
大友 祐輔
日本電信電話株式会社nttマイクロシステムインテグレーション研究所
-
西村 和好
日本電信電話株式会社マイクロシステムインテグレーション研究所
-
西原 晋
日本電信電話株式会社nttフォトニクス研究所
-
西原 晋
日本電信電話株式会社 Nttフォトニクス研究所
-
大友 祐輔
Ntt マイクロシステムインテグレーション研
-
野河 正史
日本電信電話株式会社マイクロシステムインテグレーション研究所
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