動的フローに適応したネットワークプロセッサ設計とその評価(論理設計-3, システムオンシリコン設計技術並びにこれを活用した VLSI)
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概要
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本稿では, 動的フローに適応したネットワークプロセッサを提案する.提案ネットワークプロセッサは, ネットワークプロセッサ内の各処理ユニットの中から, ボトルネック処理をコマンド待ちキュー情報・各処理ユニットに必要とされるサイクルカウントを元に判断し, 全体スループットを改善する為に次に行うべき処理を採択し, それを実行するハードウェア機構を備えている.この処理状態管理ハードウェアとネットワークプロセッサ内の各処理ユニットに必要な命令・データパスを備えたDynamic-Micro Packet Processorが, 随時ボトルネック処理の並列化を行うことで, ネットワークプロセッサ全体のスループット向上を実現する.提案アーキテクチャをHW記述言語であるVHDLを用いて実装し, 計算機実験を行うことで, その有効性を評価する.
- 2005-03-04
著者
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
宮岡 祐一郎
早稲田大学理工学部コンピュータ・ネットワーク工学科
-
戸川 望
北九州市立大学国際環境工学部情報メディア工学科
-
宮岡 祐一郎
早稲田大学理工学部コンピュータ・ネットワーク工学科:(現)株式会社東芝
-
細田 宗一郎
早稲田大学理工学部コンピュータ・ネットワーク工学科
-
柳澤 政生
早稲田大学
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