Virtual Socket Architectureを用いたEmbedded DRAMの設計手法
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概要
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Embedded DRAMの設計期間(turn around time)を一般的なCMOS ASICと同程度に短縮できる「Virtual Socket Architecture」を提案する。本提案の特徴は、一般的な同期回路設計で使用される自動設計支援ツールを最大限に生かすために、DRAM固有の制御回路部分をソフトマクロで提供したことである。本提案によるテストデバイスを0.18um級プロセスで試作し、166MHzでの動作を確認した。
- 社団法人電子情報通信学会の論文
- 2000-11-23
著者
-
有本 和民
三菱電機株式会社ulsi技術開発センター
-
堂坂 勝己
(株)ルネサステクノロジシステムコア技術統括部
-
天野 照彦
三菱電機株式会社ulsi技術開発センター
-
山内 忠昭
三菱電機株式会社ULSI技術開発センター
-
木下 充矢
三菱電機株式会社ULSI技術開発センター
-
堂阪 勝巳
三菱電機株式会社ULSI技術開発センター
-
木下 充矢
(株)ルネサステクノロジ
-
天野 照彦
ルネサスエレクトロニクス株式会社
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