2種類のレジスタファイルを持ったディジタル信号処理向けプロセッサのハードウェア/ソフトウェア協調合成システムとその並列化コンパイラ
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概要
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ディジタル信号処理において高い演算精度を保つためには, 演算の途中結果は入カ系列のビット幅より大きなビット幅を持つ必要がある. ディジタル信号処理向けプロセッサが2種類のレジスタファイルを持てば, 演算精度を保ち, しかも小さいハードウェア面積でディジタル信号処理アプリケーションを実現することができる. 本稿では, レジスタビット幅の異なる2種類のレジスタファイルを持ったディジタル信号処理向けプロセッサのハードウェア/ソフトウェア協調合成システムおよびその並列化コンパイラを提案する. 本システムはアプリケーションプログラムのC言語記述およびアプリケーションデータを入力とし, プロセッサのハードウェア記述, プロセッサ上で動作するオブジェクトコードおよびソフトウェア環境を出力とする. 並列化コンパイラは, 与えられたC言語記述からターゲットアーキテクチャで想定される全てのハードウェアユニットを持つプロセッサ上で動作するアセンブリコードを出力する. この際, アプリケーションが持つ並列度を最大限に抽出し, 実行時間の最小化を目指す. さらに2つのデータ型から変数を2種類のレジスタファイルに割り当て, 演算精度を保つアセンブリコードを生成できる. 計算機実験によって本システムを評価した結果を報告する.
- 社団法人電子情報通信学会の論文
- 1999-02-05
著者
-
戸川 望
早稲田大学
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
中村 剛
早稲田大学理学部数学教室
-
中村 剛
早稲田大学理工学部電子・情報通信学科
-
中村 剛
早稲田大学大学院基幹理工学研究科
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