FPGAのマクロブロックを対象とした配置概略配線同時処理手法
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概要
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FPGAのマクロブロックとは, FPGA上で複数の論理ブロックがまとまって1つの機能を実現するブロック集合である.マクロブロックはFPGAの周波数を上げるためやFPGAの論理ブロックの使用率を上げるのに不可欠である.このマクロブロックのレイアウトでは, 単純な論理ブロックの変換やレイアウト領域の分割による配置配線は適用できない.本稿では, このようなFPGAのマクロブロックを対象として, トップダウン分割とボトムアップ結合を組み合わせた配置概略配線同時処理手法を提案する.提案手法は, トップダウン分割段階とボトムアップ配置概略配線段階の2段階で構成される.トップダウン分割段階ではマクロブロック間の配線を考慮しながら階層的にレイアウト領域を分割する.ボトムアップ配置概略配線段階では, 階層的にマクロブロックを配置概略配線しながら結合する.計算機実験により手法の有効性を評価した結果を報告する.
- 社団法人電子情報通信学会の論文
- 1998-12-10
著者
-
戸川 望
早稲田大学
-
柳澤 政生
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学基幹理工学研究科情報理工学専攻
-
大附 辰夫
早稲田大学
-
井上 大輔
早稲田大学理工学部電子・情報通信学科
-
柳澤 政生
早稲田大学
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