連続可変な駆動能力を実現するフレキシブル・セルのレイアウト構造とスタティックCMOS組み合わせ論理回路への適用
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概要
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早いタイミング収束を達成するため、今井らが提案したFHM(Flexible Hardware Model)の概念[1,2]に基づき、スタティック CMOS 回路方式の組み合わせ論理セルに対して、連続可変な駆動能力を実現するフレキシブル・セルのレイアウト構造を提案する。最初に、0.35μmデザイン・ルールに基づき、V_DD=3.3Vの場合に、2段論理の後段駆動インバータとして最小のトランジスタ幅であるn-MOSFETで構成するその駆動インバータで、基板バイアス|V_SB|が共に3.3Vの時に、エネルギー(=消費電力×遅延時間)がほぼ最小であることを示す。次に、典型的な組み合わせ論理セルとしてAO23(2入力ANDが3並列OR)と全加算器を取り上げ、トランジスタ幅と配線RC及びファンアウト容量の3つの設計指標を独立変数としたフレキシブル・セルの遅延時間と消費電力及びエネルギーの高精度モデルを確立した。
- 社団法人電子情報通信学会の論文
- 2002-06-21
著者
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