多相クロックアーキテクチャによる1.7W 50 Gbit/s InP HEMT 4:1 マルチプレクサIC
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概要
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多相クロックアーキテクチャによる4:1マルチプレクサICの低消費電力・高速動作について報告する。多相クロックアーキテクチャは、4相クロックを発生するトグル・フリップフロップと4:1多重動作を行う縦積み4:1セレクタから構成されることを特徴とする。InP HEMTを用いた試作ICは、出力振幅1Vpp,消費電力1.71Wで50Gbit/sエラーフリー動作を達成した。1.71Wの消費電力は従来のツリーアーキテクチャによるInP HEMT 4:1マルチプレクサの消費電力の1/3以下であり、この大幅な消費電力削減にも関わらず動作速度(50Gbit/s)と出力振幅(1Vpp)は維持されている。
- 社団法人電子情報通信学会の論文
- 2003-01-09
著者
-
村田 浩一
日本電信電話株式会社NTTフォトニクス研究所
-
村田 浩一
NTTフォトニクス研究所
-
榎木 孝知
NTTフォトニクス研究所
-
佐野 公一
NTTフォトニクス研究所,日本電信電話株式会社
-
杉谷 末広
NTTフォトニクス研究所
-
菅原 裕彦
NTTアドバンステクノロジ(株)
-
菅原 裕彦
NTTフォトニクス研究所
-
杉谷 末広
日本電信電話株式会社 Nttフォトニクス研究所
-
杉谷 末広
Ntt フォトニクス研
-
佐野 公一
日本電信電話株式会社
-
佐野 公一
NTTフォトニクス研究所
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