擬似ベクトルプロセッサPVP-SWのシミュレーション評価
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概要
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大規模科学技術計算の分野では、データ領域が非常に大きく、データの時間的局所性が少ない。そのためスカラプロセッサではデータキャッシュが有効に働かず、主記憶アクセスペナルティのために性能が著しく低下する。この問題に対処するため、我々は浮動小数点レジスタをスライドウィンドウ化した擬似ベクトルプロセッサPVP-SW(Pseudo Vector Processor based on Sidewindowed Registers)を提案し、その有効性を既に確認している。しかし、これまでに報告したPVP-SWの評価は、主記憶が理想的にパイプライン化されていること、及び、ベクトル長が十分に長いことを仮定している。実際には主記憶のパイプライン化はマルチバンク構成により擬似的に実現される。また実用上は短いベクトル長の場合の性能も重要である。そこで、今回はマルチバンク構成の主記憶を用いた場合、及び、ベクトル長が短い場合のPVP-SWの性能評価を計算機シミュレーションを用いて行なった。本稿ではその性能評価結果を報告する。
- 一般社団法人情報処理学会の論文
- 1994-09-20
著者
-
朴 泰祐
筑波大学電子・情報工学系
-
板倉 憲一
筑波大学電子・情報工学系
-
中村 宏
筑波大学電子・情報工学系
-
中澤 喜三郎
筑波大学電子・情報工学系
-
広野 哲
筑波大学電子・情報工学系
-
板倉 憲一
筑波大学計算物理学研究センター
-
廣野 哲
株式会社日立製作所汎用コンピュータ事業部
-
廣野 哲
筑波大学電子・情報工学系
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