HPC向けプロセッサのメモリ・アーキテクチャの基本構成
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概要
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近年のプロセッサは,クロック周波数の向上,命令レベル並列性の活用などにより高性能化が著しい.しかし,一方でメインメモリの性能はプロセッサほど改善されてはおらず,プロセッサとメインメモリとの性能格差の問題が深刻になってきている.さらに,今後この差は拡大すると予想される.我々はその性能格差に対処し,さらに高性能を得るべくプロセッサ・メモリ混載型LSIについて,特にHPC分野をターゲットとして検討している.本稿では,我々の提案するプロセッサ・メモリ混載型LSIについて,そのメモリアーキテクチャの基本構成を提示する.
- 一般社団法人情報処理学会の論文
- 1999-08-02
著者
-
朴 泰祐
筑波大学電子・情報工学系
-
中村 宏
東京大学先端科学技術研究センター
-
坂井 修一
東京大学工学系研究科電気工学
-
近藤 正章
筑波大学電子・情報工学系:(現)東京大学先端科学技術研究センター
-
坂井 修一
東京大学工学研究科電気工学専攻
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